Буферное запоминающее устройство
Похожие патенты | МПК / Метки | Текст | Заявка | Код ссылки
Текст
187238 1Изобретение относится к вычислительной технике и может быть использовано при построении буферных запоминающих устройств системы цифровойобработки телевизионного сигнала, 5при реализации алгоритмов сокРащенияинформационной избыточности и для согласования устройств с различнымтемпом обработки информации.10Цель изобретения - повышение быстродействия и расширение области применения устройства за счет контрдлязаполнения памяти.На фиг. 1 представлена структурная схема буферного запоминающегоустройства; на Фиг. 2 - структурнаясхема блока анализа заполнения памяти; на Фиг. 3 - функциональная схемаформирователя сигналов записи (а) и 20Формирователя сигналов считывания инФормации (б); на фиг. 4 и 5 - схемыраспределителей входных и выходныхданных; на фиг, 6 - схема блока приоритета, на фиг. 7 - структурная схе-. 25ма блока управления; на Фиг. 8 - схема блока Формирования временной диаграммы,Буферное запоминающее устройство(фиг, 1) содержит накопитель 1, состоящий из блоков 2 памяти, регист,ры 3 входных данных, дополнительныерегистры 3 входных данных, регистры 4 адресов записи, регистры 5 адресов регенерации, шинные формирователи 6, счетчик 7 адресов записи,счетчик 8 адресов считывания, счетчик 9 адресов регенерации, Формирователь 10 сигналов записи, формирователь 11 сигналов считывания, блок 12 40приоритета, блок 13 анализа заполнения памяти, блок 14 управления, регистры 15 выходных данных, адресныеинформационные входы 16 накопителя,распреДелитель 17 входных данных и 45распределитель 18 выходных данньи.Блок 2 памяти содержит матрицу 19памяти и блок 20 формирования временной диаграммы. Накопитель 1,имеет входы 21 управления и входы-выхо/ды 22 блоков 2 памяти.Кроме того, устройство включаетвходы 23 и 24 регистров 3, информационные входы 25 устройства, входы 26Регистров 3 .и вьиоды 27 распределителя 17, управляющий вход 28 устройства, на который поступает сигнал сопровождения информации, входы 29 регистров 3, на которые поступают сиг 2налы управления выдачей информации,выходы 30 и 31 регистров 3, вход 32счетчика 7, выход 33 блока 14 управления, выход .34 блока 14, выходы 35регистров 4, входы 36 регистров 4,на которые поступают сигналы управления приемом и выдачей информации сблока 14, выходы 37 регистров 4,вход 38 счетчика 9,выход 39 блока 14,выход 40 счетчика 9, выходы 41 и 42регистров, 5, выход 43 блока 4, выходы 44 регистров 5, входы 45 и 46шинных формирователей 6, выходы 47блока 44, входы 48 формирователей 6,входы 49 и 50 регистров 15, выходы 51 распределителя 18, управляющий вход 52 устройства (сигнал требования данных), вход 53 регистров 15, выход 54 блока 14, информационные выходы 55 регистров 5,вход 56 счетчика 8, выход 57 блока 14, управляющие входы 58 и 59 устройства, на которые поступают сигналы сопроволдения информации и сигналы требования выдачи данных соответственно, выходы 60 и.61 формирователей 10 и 11, входы 62, 63 и 64, 65блоков 13 и 12 соответственно,Фвход 66 блока 12 на который поступает сигнал регенерации с блока 14,выходы 67 и 68 блока 12, входы 69 и70 блока 14, управляющий вход 71устройства (сигнал начала телевизионного кадра), выходы 72 и 73 блока 13,входы 74 и 75 блока 12 и управляющий выход 76 устройства (сигнал пропуска телевизионного кадра),Блок 13 анализа заполнения памяти (фиг. 2) содержит реверсивный двоичный счетчик 77, сумматоры 78 и 79, регистр 80 хранения максимального ададреса накопителя 1, регистр 81 хранения среднего значения числа слов телевизионного кадра, формирователь 82 сигнала запрета записи, формирователь 83 сигнала считывания, элемент И-НЕ 84, выход 85 счетчика 77, входы 86 и 87 формирователя 83 и сумматора 78 соответственно, вход 88 сумматора, вьиоды 89 регистра 80, выходы 90 и 91 сумматора 78, входы 92 и 93 формирователя 82 и сумматора 79 соответственно, вход 94 сумматора 79, выход 95 регистра 81, выход 96 сумматора 79 и вход 97 элемента И-НЕ 84.Формирователь 10 сигналов записи (фиг. За) содержит делитель 98 частоты с коэффициентом деления 32 и триг 1287238(фиг. 5) содержит счетчики 111 и 112, 1 Одешифраторы 113-116, элементы И-НЕ 17120 и элементы НЕ 121-123.Блок 12 приоритета (фиг. 6) содержит элементы И-НЕ 124-127. Наивысшимприоритетом обладает режим регенерации, затем записи и считывания.Блок управления (Фиг. 7) содержит блок 128, состоящий из узла выработки обращения к накопителю, блок 129выработки управляющих сигналов, гоблок 130 управления шинными формирователями, блок 131 управления счетчиком адресов записи, блок 132 управления регистрами и блок 133 управления регистрами адресов регенерации, 25Блок управления предназначен для выработки временных диаграмм, управляющих работой всего устройства. Блок 20 формирования временной диаграммы (фиг. 8) содержит шинные Формирователи 134-137, регистры 138 и 139, элементы И-НЕ 140-15 и блоки 152-154 задержки.Устройство может работать в режиме записи, считывания и регенерации,Режим записи обеспечивает после 30 и-- , (1)2 Тин Р мингде Т - период записи информации взапоминающее устройство; Т - минимальный период повтореину минния поступления информации;К - коэффициент повторения периодов. 55Для накопителей динамического типа коэффициент повторения периодов равен минимально трем (записи, считыванию и регенерации), для накопитедовательное циклическое заполнение информацией всего накопителя 1 начиная с 0-го адреса до и - 1-го адреса 4 О с последующим переходом с и - 1-гоадреса в 0-й и т,дИнформация, записываемая в накопитель 1, предварительно накапливается в одной из половин регистров 3. 45 . Количество регистров 3 выбирают из условия лей статического типа - двум (записи и считыванию).Преобразуя периоды записи и поступления информации через частоту, получают2 пи(2)Из выражения (2) видно, что частота накопителя в этом случае увеличится в 2 п/К раз.Режим считывания обеспечивает считывание информации из накопителя в порядке .поступления и выдачи ее в ререгистры 15, из которых информация побайтно по запросу (например, магнитного ленточного накопителя) передается ему.Режим регенерации обеспечивает обращение к каждой строке матрицы 19 памяти через каждые 2 мс,С информационных входов 25 поступает информация побайтно о полном телевизионном кадре с учетом реализации алгоритмов сокращения информационной избыточности, причем вначале последовательно заполняются регистры 3 с входами 23. Последовательность заполнения буферных входных ре. гистров 3 обеспечивается распределителем 17, выдающим на выходах 27.сигналы, позволяющие побайтно заполнять регистры. Распределитель 17 изменяет свое состояние под действием сигнала сопровождения информации на входе 28. Как только произойдет заполнение и буферных входных регистров, что соответствует количеству байтов И = 2 п, формирователь 1 О вырабатывает сигнал занесения информации в накопитель 1, который с выхода 60 поступает на вход 63 блока 12. С выхода 67 выдается сигнал ЗП 1, поступающий на вход 69 блока 14. Последний вырабатывает сигналы, поступающие на входы 36 и регистров 4 и входы 29 и регистров 3, а также управляющие сигналы на входы 21 накопителя 1. Под действием этих сигналов, выходы 37 регистров 4 подключаются соответствующим адресно-информационным линиям, по которым передается соответствующий адрес в блоки 2 памяти накопителя 1После передачи адреса выходы 37 регистров 4 отключаются. Поступает сигнал на вход 29 регистров 3, под действием которого выходы 30 регистров 3 подключаются к5 128 соответствующим адресно-информационным линиям, по которым передается информация, принятая с входов 25, После передачи информации (чисел) п регистров 3 и и регистров 4 обнуляются. Счетчик 7 увеличивает свое значение на единицу под действием сигнала (+1 АЗП), поступающего с выхода 33 блока 14. После изменения состояния счетчика 7 на единицу с блока 14 на входы Зб регистров 4 поступает сигнал, переписывающий значения адреса чисел со счетчика 7 в регистр 4.Пока с первых и регистров 3 переписывается информация в накопитель 1, во вторые п регистров 3 записывается информация, поступающая с входов 25, причем время заполнения регистров 3 выбирают исходя из времени, необходимого для считывания и регенерации информации.При заполнении вторых и регистров,З информацией формирователь 10 вырабатывает сигнал записи, который поступает на вход 63 блока 12 приоритета с выхода которого сигнал подается в блок 14. Последний выдает сигналы на выходы 36, подключающие выходы 37 регистров 4 к соответствующим входам-выходам 16, по которым передается адрес записи чисел, а на входы 29 вторых п регистров 3 поступают сигналы, подключающие выходы 31 к соответствующим входам-выходам 16, По адресно-информационным линиям в и блоков 2 памяти накопителя 1 передаются соответствующие адреса и инФормация, которая должна быть записана в матрицы 19 памяти по этим адресам, После занесения информации вторые и регистров 3 и и регистров 4 обнуляются.7238 6 30 ные по запросу терминала, поступающего на вход 52 распределителя 18.Режим регенерации предназначендля обновления информации. Регенерация информации осуществляется путем З 5 обращения к каждой строке не режечерез каждые 2 мс (1 мс) . Весь временной период между регенерациями разделен на число строк, получаются отдельные промежутки времени. Регене 40 рация к каждой строке происходит через равные промежутки времени. 5 О 15 20 25 формирует импульсы обращения к накопителю. На выходы 46 с блока 14 поступают сигналы, подключающие выходы счетчика 8 через соответствующие входы 48 формирователей 6 и выходы 45 к адресно-информационным входам-выходам 16, Соответствующее значение адреса с шинных формирователей поступает на входы-выходы 22 блоков 2 памяти накопителя 1. Информация по данному адресу считывается с накопителя 1 и поступает на адресно-информационные входы- выходы,на управляющие входы 46 с блока 14 поступают сигналы, подключающие входы-выходы 45 к входам 49 регистров 15. На вход 53 с выхода 54 блока 4 поступают сигналы приема информации в регистры 15. В момент передачи информации из накопителя блоком 14 вырабатывается на выходе 57 блока 14 импульс +1 АС 4, поступающий на вход 56 счетчика 8 и увеличивающий его значение на единицу. Выходы регистров 15 объединяются, поэтому выход 55 будет состоять из восьми шин.Подключение регистров 15 к входам- выходам осуществляется под действием распределителя 18, который выдает данСчетчик 7 увеличивает свое значение на единицу под действием сигнала (+1 АЗП), поступающего с блока 14. Изменение счетчика 7 происходит одновременно с выдачей адреса регистрами 4 адреса записи чисел. Переписывание адреса счетчиков 7 в регистры 4 происходит в промежутке времени, соответствующем записи информа. ции в накопительВ режиме считывания при наличии сигнала СЧ, вырабатываемого формирователем 11, на выходе 61 формируется сигнал, поступающий на вход 65 блока 12, С блока 2 сигнал подается на вход О блока 14. Последний 45 50 55 Сигнал регенерации вырабатывается блоком 14 и по нему происходит обращение к накопителю 1, по сигналу с выхода 43 блока 14 на вход 42 регистров регенерации поступает сигнал, подключающий выходы 44 к адресно-информационным входам-выходам 16. Адреса через входы-выходы 22 поступают в соответствующие блоки 2 памяти.Одновременно с выдачей адреса с регистров 5 с выхода 39 блока 14 на вход 38 поступает сигнал +1 Рег, увеличивающий значение счетчика 9 на единицу. После того, как адрес с регистров регенерации будет снят, с блока управления на входы 42 поступает сигнал, переписывающий адрес счет1287238 45 7чика регенерации в регистры 5.При рассмотрении режимов работы буферного запоминающего устройства не учитывалась достаточность ячеек памяти для размещения полного телеви зионного кадра при реализации алгоритмов сокращения информационной избыточности без учета информационного переполнения или опустошения накопителя 1. Для этой цели в устройство О введен блок 13 анализа заполнения памяти, На входы 62 и 64 двоичного реверсивного счетчика 77 поступают сигналы записи ЗП и считывания СЧ с формирователей 10 и 11, причем при по ступлении сигнала ЗП счетчик 77 увеличивает свое значение на единицу, а при поступлении СЧ - уменьшает на единицу. На выходе 85 счетчика 77 в любой момент времени зафиксировано 20 количество ячеек, занятых текущей информацией, Начальная установка счетчика 77 осуществляется под действием сигнала НУ, вырабатываемого блоком управления. Начальная установка осуществляется в момент подачи питания на буферное запоминающее устройство.Выход 85 счетчика 77 соединен с формирователем 83,предназначенным для запрета обращения к памяти при ее 30 полной очистке. Формирователь 83 состоит иэ элемента И-НЕ. Как только счетчик установится в нулевое состояние, на выходе появляется сигнал ЗАП СЧ, который поступает на блок 12 35 приоритета и запрещает считывание информации из накопителя 1Выход 85 счетчика 77 связан также с первым входом 87 сумматора 78, на второй вход которого поступает информация о 40 максимальном адресе с выхода регистра 80.Регистр 81 предназначен для хранения числа слов (Н), необходимых для размещения в памяти.ТкЮК С где Т - период действия телевизиконного кадра; 50К - средний коэффициент сокрасщения избыточности;С - количество байтов в слове.Сумматор 79 выполнен аналогично сумматору 78, Выход 96 является выхо дом знакового разряда, Если на выходе знак "0", то не произойдет переполнения, если", то произойдетпереполнение памяти. 8При поступлении на вход 97 элемента И - НЕ 84 знака числа "1" и сигнала НТК (начало телевизионного кадра) на вход 71 на выходе 76 формируется сигнал ПТК (пропуск телевизионного кадра).Таким образом, принцип работы блока 13 анализа заполнения памяти ососнован на том, что в момент прихода сигнала НТК на сумматор 78 происходит определение количества свободных чисел Ч, в памяти:где А - максимальное значение адред.ксса.или максимальное количество чисел памяти, хранящихся в регистре 80;А- текущее значение количества длин памяти, занятыхпод хранение кадра, поступающее со счетчика 7.На сумматоре 77 происходит опреде-.ление достаточности или недостаточности ячеек памяти для размещения телевизионного кадра с учетом сокращенияинформационной избыточности:1.=Ч - Чгде Ч - количество ячеек памяти, не-.обходимых для размещения телевизионного кадра с учетоминформационной избыточностии выдачи чисел терминалуКо,Ч -- + 1Ксгде Ко - количество байтов полноготелевизионного кадра;Кс - коэффициент сокращения избыточности (10-50);- число считывания чисел изнакопителя 1 за время действия кадрасгде Т - время действия (период) одного телевизионного кадра;время, необходимое для принятия одного числа терминалом.Под числом понимают информацию,записанную по одному адресу в нако-питель 1,На выходе 96 сумматора 79 форми 11 11руется сигнал в знаковом разряде Оесли ячеек достаточно для размещения кадра, и "1", если ячеек дляразмещения телевизионного кадра недостаточно. Прн поступлении этогосигнала на элемент И-НЕ 84 на второй1287238 10Выдача информации при считыванииосуществляется подачей считанной информации с матрицы 9 памяти, поступающей на входы шинных Формирователей 134-137, на управляющих входах ВК и УВ которых формируется сигнал 10 ц и з о б р е т е й и я Формула1 9вход поступает сигнал НТК. При недо статочности ячеек на выходе элемента И - НЕ 84 Формируется сигнал ПТК, пропускающий телевизионный кадр.Формирователь 10 сигналов записи работает следующим образом.На вход 58 делителя 98 частоты по ступает сигнал сопровождения информации, На выходе А 2 счетчика появляется каждый 32 импульс отрицательной 10 полярности ЗАИ ЗУ, поступающий на установочный вход триггера, устанавливая его в состояние ЗП (запись). На вход сброса триггера поступает сигнал Сбр ЗП по окончании записи числа 15 в накопитель 1.Формирователь 11 сигналов чтения работает следующим образом.На вход 59 делителя 100 частоты поступает сигнал терминала, под дей ствием которого делитель 100 меняет свое состояние. На выходе.А 2 появляется отрицательный сигнал через ка;кдые 32 импульса. На первый вход элемента ИЛИ-НЕ-И 102 поступает сигнал НУ (неначальная установка), на второй - сигнал с выхода А 2 делите-. ля 100. Выход элемента 102 соединен с входом элемента 2 И-НЕ 103, выход которого связан с одним входом триг гера 01, устанавливая его в состояние "1" (ЧТ). По окончании чтения чисел из накопителя 1 из блока 14 управления поступает сигнал Сбр ЧТ, устанавливающий триггер 101 в исходное состояние. Блок 20 формирователя временной диаграммы работает следующим образом.40С адресно-информационных входов- выходов 6 адрес обращения к ячейке памяти поступает на входы 22 шинных Формирователей 134-137. При этом для Управления режимом работы формирова телями на их входы ВК подается логический "0", а на УВ - "1". С выходов шинных формирователей адрес записи или чтения числа поступает на входы многорежимных буферных регист Ров 138 и 139, выходы которых ббъедииены, управление занесением адреса В регистры 138 и 139 осуществляется ,под действием сигнала С 1, Формируемого блоком 150 задержки и элемента ми И 14 б и 147. Выдача адреса осуЩествляется под действием сигналов ЗА 1 и ЗА 2, формируемых блоком заДержки. Ввод данных при записи осуществляется также как и при записи адресачисла, отличие. заключается в том,что число не заносится в регистры 138и 139,Буферное запоминающее устройство, содержащее блоки памяти, управляющие входы которых подключены к выходам группы блока управления, регистры входных данных, выходы которых подключены к входам-выходам.соответствующих блоков памяти, входы регистров входных данных являются информацион-. ными входами устройства, регистры выходных данных, управляющие входы которых подключены к первому выходу блока управления, выходы регистров выходных данных являются информационными выходами устройства, выходы счетчика адресов записи, счетчика адресов считывания и счетчика адресов регенерации подключены соответственно к второму, третьему и четвертому выходам блока управления, о т л и - ч а ю щ е е с я тем, что, с целью повышения быстродействия и расширения области применения за счет контроля заполнения памяти, оно содержит регистры адресов записи, регистры адресов регенерации, шинные Формирователи, блок приоритета, формирователь сигналов считывания, Формирователь сигналов записи, блок анализа заполнения памяти, распределитель входных данных, распределитель выходных данных и дополнительные регистры входных данных, выходы которых подключены к выходам соответствующих регистров входных данных и к информационным входам первых групп соответствующих шинных формирователей, выходы которых подключены к информационным входам соответствующих регистров выходных данных, управляющие входы группы которых подключены к выходам распределителя выходных данных, вход которого является первым управляющим входом устройства, выходы счетчика адре 12872311сов регенерации подключены к информационным, входам регистров адресов регенерации, выходы которых подключены к входам-выходам соответствующих блоков памяти, выходы счетчика адресов записи подключены к информационным входам регистров адресов записи, вьцюды которых подключен к входам- выходам соответствующих. блоков памяти, управляющие входы группы регист ров входных данных и дополнительных регистров входных данных подключены к выходам распределителя входных данных, вход которого является вторым управляющим входом уст ройства, выходы счетчика адресов считывания подключены к информационным входам вторых групп шинных формирователей, управляющие входы которых подключены к пятому выходу блока уп О равления, шестой и седьмой выходы которых подключены к управляющим входам соответственно регистров адресов регенерации и регистров адресов записи, управляющие входы регистров входных данных и дополнительных регистров входных данных подключены к 812восьмому выходу блока управления,первый вход которого является третьим управляющим входом устройства,нервый вход блока приоритета подключен к первому входу блока анализа заполнения памяти и к выходу формирователя сигналов записи, вход которогоявляется четвертым управляющим входом устройства, второй вход блокаприоритетов подключен к второму входублока анализа заполнения памяти и квыходу формирозателя сигналов считывания, вход которого является пятымуправляющим входом устройства, третийи четвертый входы блока приоритетаподключены соответственно к первомуи второму выходам блока анализа заполнения памяти, третий выход и третийвход которого являются соответственноуправляющим выходом и шестым управляющим входом устройства, первый и второй выходы блока приоритета подключены соответственно к второму и третретьему входам блока управления,девятый выход которого подключенк пятому входу блока приоритета, 1287238
СмотретьЗаявка
3952810, 11.09.1985
ЖИТОМИРСКИЙ ФИЛИАЛ КИЕВСКОГО ПОЛИТЕХНИЧЕСКОГО ИНСТИТУТА
ЕФРЕМОВ НИКОЛАЙ ФЕДОРОВИЧ, КАЛЮЖНЫЙ АЛЕКСЕЙ ДМИТРИЕВИЧ, ПАНОВ АЛЬБЕРТ ФЕДОРОВИЧ
МПК / Метки
МПК: G11C 19/00
Метки: буферное, запоминающее
Опубликовано: 30.01.1987
Код ссылки
<a href="https://patents.su/12-1287238-bufernoe-zapominayushhee-ustrojjstvo.html" target="_blank" rel="follow" title="База патентов СССР">Буферное запоминающее устройство</a>
Предыдущий патент: Буферное запоминающее устройство
Следующий патент: Аналоговое запоминающее устройство
Случайный патент: Ленточный пресс