Устройство для генерации пачек импульсов

СОЮЗ СОВЕТСКИХСОЦИАЛИСТИЧЕСНИХРЕСПУБЛИК ЯО 1234953 А 1(5 в 4 Н 03 К 3,84 ОписАние иЗОБРетенЙ К А ВТОРСНОМУ СВИДЕТЕЛЬСТВУ Ю ГОСУДАРСТВЕННЫЙ НОМИТЕТ СССРПО ДЕЛАМ ИЗОБРЕТЕНИЙ И ОТНРЫТИЙ(71) Минский радиотехнический институт(54) УСТРОЙСТВО ДЛЯ ГЕНЕРАЦИИ Г 1 АЧЕК ИМПУЛЬСОВ(57) Изобретение может использоваться в системах электрических испытаний изделий радиоэлектроники, а также в системах автоматики и передачи данных. Цель изобретения - расширение функциональных возможностей достигается путем генерации как однородного, так и неоднородного импульсного процесса при генерировании пачек импульсов с возможностью управления в широком диапазоне длительностями генерируемых импульсов и пауз между ними, а также количеством импульсов в пачке и длительностями пауз между пачками. Устройство содержит генераторопорных импульсов, элементы И 2, 4, 14, 16 и 17, триггеры 5, 8 и 5, счетчики 3, 13 и 20, элемент И - И,1 И 6, элементы ИЛИ 7, 9 и 21, блоки памяти 10 и 12, схемы сложения по модулю два 1 и 18, делитель 19 частоты. В устройстве предусматривается запрограммированный режим работы, если по окончании генерации очередной пачки в третий счетчик принудительно заносить состояние согласно некоторой программе.ил.5 10 15 20 25 ЗС 35 40 4 э 50 55 Изобретение относится к импульсной технике и может быть использовано в системах электрических испытаний изделий радиоэлектроники, а также в системах автоматики и передачи данных.Целью изобретения является расширение функциональных возможностей за счет генерации как одноролцого, так и неоднородного импульсного процесса пачечного типа, с возможностью управления в широком диапазоне длительностями генерируемых импульсов и пауз между ними, количеством импульсов в пачке, ллитель)остями пауз между пачками.На чертеже представлена функционал),- цая схема устройства для генерации пачек импульсов.Устройство содержитецератор 1 опорных импульсов, первый элемент И 2, первый счетчик 3, второй элемент И 4, первый триггер 5, элемент И - ИЛИ 6, первый элемент ИЛИ 7, второй триггер 8, второй элемент ИЛИ 9, первый блок 10 памяти, первую схему 11 сложения по модулю два, второй блок 12 памяти, второй счетчик 13, третий элемент И 14, третий триггер5, четвертый 16 и пятый 17 элементы И, вторую схему 18 сложения по модулю два, делитель 19 частоты, третий счетчик 20 и третий элемент ИЛИ 2. Выход генератора 1 опорных импульсов соединен с входом делителя 19 частоты, счетным входом счетчика 3 и первым входом элемента И 2, второй вход которого соединен с выходом элемента ИЛИ 7, а выход -- с входом управления счетчика 3, первым входом элемента ИЛИ 21 и четвертым входом элемента ИЛИ 7. Информационный вход счетчика 3 соединен с выходом блока 10 памяти, а выход с входом элемента И 4. Вход устаноВки е)1 ицичцОГО сост 051 ция 1 риГеоа 5 соединен с прямым выходом триггера 8, ВхОдОм установки сдинии 010 .Ост 05 Н)ия триГ- гера 15, первыми Входами элемеГгов ИЛИ 7 и 9, первымц Входами схем 11 и 18 сложе- НР я по;Олул)О два и Вторым Входом элемента И 16, а выходс вторым входом схем ы 1 1 с 51 0 ж Р и и 51 и 0 м Одъл ю д В а, 1)с р Вы м Вхо,10 м эс)мента И 6 и первым Входом элемента И - ИЛИ 6. Выход элехсГга И 4 соелицсц с вторым Входом элемента ИЛИ 7. Вход трип ера 8 является Входом устройства. Входы старших разрядов адреса блоков 10 и 12 пах)яти соединены с и )форациоцпьм выходом счетчика 20, Вхо 1 ы )1,11),1- шего разряда алр са -- с выхо,1 ами стветствеццо схем1 и 18 сложения по молу.ю лва. Выхо;1 делителя 19 ч)стс)ы сосдипец с третьим вхолом элемеГга И И:1 И 6, В) о- рОЙ ВХОД КОТОРОГО СОЕДИНЕН С Пря)ЫМ Вь)- ходом трип ера 15, вторым Входом схемы 18 слокени 51 по мо,1 у;к) два и ВхОЛОм ус 15)цвки начального состояния делителя 19 частоть 1, четверт 1)й Вход с Ооратным Выходом триггера 15, а выхо,1 - с счетным входом счетчика 13 и вторым входом элемента И 17, первый вход которого соединен с выходом элемента ИЛИ 9, а выход - с входом управления счетчика 13, счетным входом триггера 15 и третьим входом элемента ИЛИ 9. Информационный выход счетчика 13 соеди.ен с входом элемента И 14, выход которого соединен с вторым входом элемента ИЛИ 9, информационный вход - с первым выходом блока 12 памяти, второй выход которого соединен с входом управления коэффициентом деления делителя 19 частоты. Гчетный вход триггера 5 соединен с выходом элемента ИЛИ 21, вход установки нулевого состояния с инверсным выходом триггера 15 и вторым входом элемента ИЛИ 21. Третий вход элемента ИЛИ 7 соединен со счетным входом счетчика 20 и обратным Выходом триггера5. Вход элемента И 4 соединен с информационным выходом счетчика 13 а выход -- с вторым входом элл ента ИЛИ 9. Выход элемента И 16 является Выходом устройства.Функционирование устройства представляет собой последовательность повторяющихся циклов генерации пачек и пауз между пачками, причем для каждого нового цикла задак)тся свои параметры: длительности импульсов и пауз между ними в пачке, количество импульсов в пачке, ллительность паузы между данной пачкой и следующей.Генератор 1 опорных импульсов гецерирут последовательность тактовых импульсог устройства и может быть реализован ца микросхеме 155 АГЗ..ри наличии х рОВня ЛОГическоГО нм.я на входе управления счетчика 3 последний по каждому тактовому импульсу, поступающему ца его счетный вход, увеличивает свое сосгояцие ца единицу, цри наличии уровня логической единицы на этом входе в счетчик 3 заносится код, поступаюший ца его информационный Вход. Подобные счетчики имеются в интегральном исполнении, например, 155 ИЕ 7. 5 палогично функционирует и реализуется счетчик 13. ).ля построения счет:ика 20 также можно использовать микросхему55 ИЕ 71 риггеры 5 и 5 - счетные, триггер 8 - 1 х.э типа.,1 Л 5 построения триггеров 5, 8 и 15 можно использовать микросхемы 155 ТМ 2.Д 5 построения блоков 10 и 12 памяти можГо использовать микросхемы 1802 ИР. При отсутствии необходимости управления ар-метрами пачечного неоднородного импульсного процесса в качестве блоков памяти можно использовать ПЗУ, аьример микросхему 556 РТ 5.Первая и вторая схемы 11 и 18 сложения по модулю два могут строиться па микрох:")е 5) П 5У элемента И- - ИЛИ 6 функцией И обьелиен первый вход с вторым, а третий с четвертым. Первые входы э,емеГгов ИЛИ 75055 и 9 - инверсные, остальные входы и выходы - прямые.Делитель 19 частоты предназначен для деления частоты тактовых импульсов во время формирования паузы между пачками импульсов. Используется управляемый делитель частоты, коэффициент деления которого может изменяться в широком диапазоне в соответствии с широким диапазоном изменения длительностей пауз между пачками. В случае значительного превышения длительностью паузы между пачками длительности импульсов в пачке и пауз между ними для формирования длительностей пауз между пачками требуется частота, которая значительно меньше тактовой частоты, в этом случае коэффициент деления делителя частоты должен быть большим. В то же время при малых длительностях пауз между пачками требуется высокая точность их формирования, что требует высокой частоты импульсной последовательности, используемой для этой цели, и коэффициент деления делителя 19 частоты в этом случае должен быть небольшим. Делитель 19 частоты реализован на счетчике, например 155 ИЕ 7, счетный вход которого является первым входом делителя частоты, а поразрядные выходы соединены с входами коммутатора, например 155 КП 5. На Ч-входы коммутатора поступает код управления коэффициентом деления, выход коммутатора является выходом делителя частоты. Вход установки нулевого состояния счетчика является более приоритетным по сравнению со счетным входом, и при наличии единичного сигнала на этом входе (вход установки начального состояния делителя частоты) счетчик сохраняет нулевое состояние и импульсы на выход делителя частоты не поступают. При отсутствии сигнала на входе установки начального состояния делителя 19 частоты счетчик делителя частоты осуществляет циклическое суммирование тактовых импульсов, один из выходов этого счетчика согласно коду управления коэффициентом деления делителя частоты через коммутатор подключается к выходу делителя частоты. Коэффициент деления такого делителя частоты К=2, где М - код управления коэффициентом деления. Началу работы устройства предшествует режим настройки, включающий в себя запись в блоки 1 О и 12 памяти кодов параметров генерируемого импульсного процесса. В первый блок 10 памяти по четным адресам записываются обратные коды длительностей пауз между импульсами, по нечетным - обратные коды длительностей импульсов. Во второй блок 12 памяти записываются параметры пачек: по четным адресам - обратные коды длительностей пауз между пачками и коды управления коэффициентом деления делителя 19 частоты, по нечетным - обратные коды количества импульсов в пачках. о 15 20 25 30 35 40 Всего в блоки О и 12 памяти записывается М/2 наборов указанных параметров, где Х - объем каждого из блоков памяти.При использовании в качестве блоков памяти ПЗУ этап записи параметров процесса в блоки памяти исключается,В исходном состоянии триггер 8 находится в нулевом состоянии, нулевой уровень с его прямого выхода поступает на инверсные входы установки единичного состояния триггеров 5 и 15, удерживая их в единичном состоянии. Третий счетчик 20 находится в некотором 1-м состоянии (0Я/2), а в счетчики 3 и 13 заносятся обратные коды соответственно длительности импульсов и количества импульсов в пачке 1-го набора параметров, считанные из блоков 10 и 12 памяти по нечетным адресам, старшие разряды которых представляют собой код 1-го состояния счетчика 20, а младшие разряды сформированы на выходах соответственно схем 11 и 18 сложения по модулю два. Запись кода в счетчик 3 осуществляется импульсами с выхода элемента И 2, на первый вход которого поступают импульсы с выхода генератора 1 опорных импульсов, на второй - уровень единицы с выхода элемента ИЛИ 7, открытого по первому инверсному входу нулевым уровнем с прямого выхода триггера 8. Так как вход управления счетчика 3 является более приоритетным по сравнению со счетным входом, в момент записи кода прибавления диницы к этому коду не происходит. В счетчик 13 запись кода осуществляется единичным уровнем с выхода элемента И 17, на первый вход которого поступает уровень единицы с выхода элемента И - ИЛИ 6, открытого по первому и второму входам единичными уровнями прямых выходов триггеров 5 и 15, на второй вход - единичный уровень с выхода элемента ИЛИ 9, открытого по первому инверсному входу уровнем нуля, поступающим с прямого выхода триггера 8.Функционирование устройства начинается по сигналу начала генерации, поступающему на вход устройства и устанавливающему триггер 8 в единичное состояние. Единичный уровень с выхода триггера 8 поступает на инверсный вход первого элемента ИЛИ 7, на выходе которого формируется уровень нуля, закрывающий по второму входу элемент И 2. Нулевой уровень, поступающий с выхода элемента И 2 на вход управления счетчика 3, разрешает работу этого счетчика в режиме счета, и счетчик начинает последовательно увеличивать свое состояние по каждому импульсу, поступающему на его счетный вход с выхода генератора 1 опорных импульсов. При этом единичное состояние триггера 5 через открытый единичным уровнем с выхода триггера 8 элемент И 16 поступает на выход устройства, ооусловливая формирование первого импульса первой генерируемой пачки. Кроме того, единичный уровень с выхода триггера 8 через элемент ИЛИ 9 и элемент5 1 О 15 20 ИЛИ 17 разрешает работу счетчика 13 в счетном режиме, и этот счетчик увеличивает свое состояние на единицу в результате поступления на его счетный вход первого формируемого импульса, проходящего с выхода триггера 5 через элемент И - ИЛИ 6, открытый по второму входу уровнем логической единицы с прямого выхода триггера 15. При достижении единиц во всех разрядах счетчика 3 на выходе элемента И 4 формируется сигнал, который через элемент ИЛИ 7 поступает на вход элемента И 2, и по следующему тактовому импульсу с выхода генератора 1 опорных импульсов на его выходе формируется сигнал, по которому в счетчик 3 заносится обратный код длительности паузы 1-го набора параметров, считанный из блока 10 памяти по адресу, старшие разряды которого представляют собой код 1-го состояния счетчика 20, а младший, в данном случае нулевой, разряд сформирован на выходе схемы 11 сложения по модулю два, на первый и второй входы которой к этому моменту поступали единичные уровни с выходов соответственно триггеров 5 и 8. Кроме того, сигнал с выхода элемента И 2 через элемент ИЛИ 21 поступает на счетный вход триггера 5, устанавливая его в нулевое состояние и заканчивая формирование первого импульса заданной длительности в первой генерируемой пачке. В результате записи в счетчик 3 нового кода сигнал с выхода элемента И 4 снимается, однако единичный уровень на выходе элемента ИЛИ 7 поддерживается в течение длительности тактового импульса, поступающего на его четвертый вход с выхода элемента И 2. Элемент И 2, выход которого соединен с входом элемента ИЛИ 7, и элемент ИЛИ 7, выход которого соединен с входом элемента И 2, представляют собой одноступенчатый асинхронный КЯ-триггер, причем первый, второй и тре-ий входы элемента ИЛИ 7 являются обьединенным функцией ИЛИ Я-входом, первый вход элемента И 2 - инверсным К-входом, а выход элемента И 2 - обратным выходом триггера, Такая организация необходима для надежной записи в счетчик 3 очередного кода, а также для блокировки счета этого счетчика во время занесения кода, что обеспечивается приоритетностью его входа управления по сравнению со счетным входом. По окончании длительности тактового импульса, осуществляющего через элемент И 2 запись в счетчик 3 обратного кода длительности паузы, сигнал с четвертого входа элемента ИЛИ 7 снимается, и разрешается дальнейшее функционирование счетчика 3 в режиме счета.Начинается формирование первой паузы между импульсами в пачке, при этом счетчик 3 по каждому тактовому импульсу, поступающему на его счетный вход, последовательно увеличивает свое состояние на единицу. По окончании формирования длительности паузы счетчик 3 снова достига 25 30 35 40 45 50 55 ет своего максимального состояния, на выходе элемента И 4 появляется сигнал, который, поступая через элемент ИЛИ 7 на второй вход элемента И 2, разрешает по последукнцему тактовому импульсу запись в счетчик 3 кода длительности импульса 1- го набора параметров, считанного из блока 10 памяти по адресу, младший разряд которого сформирован на выходе схемы 11 сложения по модулю два, на первый вход которой поступал единичный сигнал с выхода триггера 8, на второй - уровень нуля с выхода триггера 5. Сигнал с выхода элемента И 2 поступает через элемент ИЛИ 21 на счетный вход триггера 5 и устанавливает последний в единичное состояние, которое передается на выход устройства. Начинается формирование второго выходного импульса аналогично формированию первого. При этом счетчик 13 снова увеличивает свое состояние на единицу. Взаимодействие блоков 7, 2 и 3 при занесении кода импульса аналогично описанному,Процесс генерации импульсов и пауз повторяется до тех пор, пока состояние счетчика 13 не станет максимальным. При достижении состоянием счетчика 13 его максимального значения на выходе элемента И 14 формируется сигнал, который через элемент ИЛИ 9 поступает на первый вход элемента И 17. Следующий импульс, генерируемый устройством, проходит через элемент И - ИЛИ 6 и элемент И 17 на вход управления счетчиком 13, в результате чего в этот счетчик заносится обратный код длительности паузы между пачками для 1-го набора параметров, считанный из блока 12 памяти по адресу, старшие разряды которого представляют код 1-го состояния счетчика 20, а значение младшего разряда, в данном случае нулевое, сформировано на выходе схемы 18 сложения по модулю два, на входы которой поступали единичные уровни с прямых выходов триггеров 8 и5. Элемент ИЛИ 9 и элемент И 17 так же, как и аналогичные элементы И 2 и ИЛИ 7, представляют собой одноступенчатый асинхронный К 8-триггер, обеспечивающий надежную зались очередного кода в счетчик 13 в течение длительности импульса, поступающего с выхода элемента И - ИЛИ 6, а также блокировку счета этого счетчика во время занесения кода. Кроме того, импульс с выхода элемента И 17 поступает на счетный вход триггера 15 и по его заднему фронту последний устанавливается в нулевое состояние. При этом элемент И - ИЛИ 6 закрывается по второму входу и открывается по четвертому; по положительному перепаду на обратном выходе триггера 15 в счетчик 20 прибавляется единица, формируя код его 1+ 1-го состояния; единичный уровень с обратного выхода триггера 15 через элемент ИЛИ 7 открывает по второму входу элемент И 2.С входа установки начального состоянияделителя 19 частоты единичный сигнал снимается, и на выходе делителя частоты формируется последовательность импульсов с частотой 1 г/2, где 1 г - частота последователь 5ности тактовых импульсов, формируемых генератором 1.В результате занесения в счетчик 13 нового кода сигнал на выходе элемента И 14прерывается и счетчик снова работает врежиме счета. Теперь на его счетный вход 10поступают через открытый по четвертому входу элемент И - ИЛИ 6 импульсы с выходаделителя 19 частоты и начинается формирование длительности паузы между первой ивторой пачками импульсов. В то же времяимпульсы с выхода генератора 1 проходят через открытый по второму входу элемент И 2на вход управления счетчика 3, занося в негообратный код длительности импульса 1+ 1-гонабора параметров, считанный из блока 10памяти по адресу, сформированному из кода 1+1-го состояния счетчика 20 и младшего разряда, значение которого сформировано на вь 1 ходе схемы 11 сложения по модулюдва из значения нулевого и единичного состояний соответственно триггеров 5 и 8. Входустановки нулевого состояния триггера 5 является более приоритетным по сравнениюсо счетным входом, и в течение времени формирования длительности паузы между пачками триггер 5 удерживается в нулевом состоянии единичным уровнем с обратного вы 30хода триггера 15. При этом на счетном входеэтого триггера присутствует уровень единицы, поступающий через элемент ИЛИ 21 собратного выхода три ггера 15.В результате последовательного суммирования импульсов, цоступаюгцих на счетныйвход счетчика 13, последний снова достигаетсвоего максимального состояния, на выходеэлемента И 14 формируется сигнал, которыйоткрывает через элемент ИЛИ 9 элемент И 17по второму входу, и следующий импульс с выхода делителя 19 частоты проходит через 40элемент И - ИЛИ 6 и элемент И 17 на входуправления счетчика 13, заносит в этот счетчик обратный код количества импульсов впачке импульсов для 1+1-го набора параметров, а по заднему фронту этого импульса триггер 15 устанавливается в единичное состояние, заканчивая формирование паузымежду первой и второй пачками импульсов.Длительность сформированной паузыТ;=11/2 1 К,где К - код длительности паузы междупачками для -го набора параметров. Приэтом единичный сигнал с входа устанозкинулевого состояния триггера 5 снимается,отрицательный перепад на его счетном входевоспринимается как задний фронт импульсадлительностью Т, и первый триггер 5 устанавливается в единичное состояние.Вследствие установки единичного состояния триггера 15 элемент И - ИЛИ 6 снова закрывается по четвертому входу и открывается по второму, элемент И 2 через элемент ИЛИ 7 закрывается по второму входу, счетчик 3 начинает работу в режиме счета, начиная формирование первого импульса второй пачки. Функционирование блоков устройства при генерации второй пачки аналогично их работе при генерации первой пачки. Параметры пачки определяются новым 1+ 1-ым состоянием счетчика 20,Процесс генерации пачек импульсов и пауз между пачками циклически повторяется. При этом по окончании формирования каждой пачки счетчик 20 увеличивает свое состояние на единицу, подготавливая переход к новому набору параметров для следующей пачки. Циклически изменяя свое состояние, этот счетчик обеспечивает считывание всех наборов параметров пачек из блоков памяти.Таким образом, при генерации каждой новой пачки осуществляется переход к новым параметрам длительности импульсов, пауз между импульсами, количеству импульсов в пачке, длительности паузы между данной пачкой и следующей, что обусловливает неоднородность формируемого импульсного процесса пачечного типа.Заканчивается процесс генерации пачек при поступлении ца вход устройства сигнала окончания генерации, который устанавливает триггер 8 в нулевое состояние. При этом триггерь 1 5 и 15 устанавливаются в едицичцое состояние, элемент И 16 закрывается цо первому входу, и состояние триггера 5 ца выход устройства не поступает.Если заблокировать прибавление единицы в счетчик 20 в конце генерации каждой пачки, то генерируемый импульсный процесс будет однородным. Однородность процесса можно также обеспечить за счет настройки устройства путем записи в блоки памяти одинаковых наборов параметров по всем парам адресов.Данное устройство может осуществлять также программный режим работы, если по окончании генерации очередной пачки в третий счетчик принудительно заносить состояние согласно некоторой программе.Если задавать длительности пауз между пачками, равные длительностям пауз между импульсами в пачках, устройство будет выполнять функции генератора последовательности импульсов с управляемыми парамет- р Я. 11.Форхи 17 лйУстройство для генерации пачек импульсов, содержагцее генератор опорных импульсов, выход которого подключен и первому вхо р первого элемента 11, выход копорок подключен к входу управления пер.вого счетчика цмпузьсов, информационный1234953 10 Сосзаиителн В. Чижов 1 евреи И. пер с Корректор Л Обру нар Тираж 816 11 однисное ВНИИПИ Государственного комитета СССР по делам изобретений и открытий 13035, йгосина, Ж - 35, Раушская наб., д. 4/5 Филиал ППП Патент, г. Ужгород, ул Проектная, 4Редактор ЛежиинаЗаказ в/Воот выход которого соединен с входом второго элемента И, первый триггер, прямой выход которого соединен с первым входом элемента И - ИЛИ, первь 1 й элемент ИЛИ, отличаюи 4 ееся тем, что, с целью расширения функциональных возможностей, в него введены второй и третий триггеры, второй элемент ИЛИ, третий элемент ИЛИ, первый и второй блоки памяти, первая и вторая схемы сложения по модулю два, второй и третий счетчики импульсов, третий, четвер- О тый и пятый элементы И и делитель частоты, причем вход устройства подключен к установочному входу второго триггера, выход ко. торого соединен с первым входом первого элемента ИЛИ, с первым входом второго элемента ИЛИ, с инверсными входами установки в единичное состояние первого и третьего триггеров, с первыми входами первой и второй схем сложения по модулю два и с первым входом четвертого элемента И, второй вход которого подключен к второму входу первой схемы сложения по модулю два и к прямому выходу первого триггера, вход установки в нулевое состояние которого подключен к инверсному выходу третьего триггера, к четвертому входу элемента И - ИЛИ, к счетному входу третьего счетчика импульсов, 25 к третьему входу первого элемента ИЛИ и к второму входу третьего элемента ИЛИ, выход которого подключен к счетному входу первого триггера, первый вход третьего элемента ИЛИ соединен с выходом первого элемента И и с четвертым входом первого эле мента ИЛИ, второй вход которого соединен с выходом второго элеменза И, а выход соединен с вторым ВхОдОм первого элемента И, при этом выход генератора опорных импульсов подключен к входу делителя частоты и счетному входу первого счетчика импульсов, информационный вход которого подключен к выходу первого блока памяти, входы младших разрядов которого соединены с выходом первой схемы сложения по модулю два, входы старших разрядов соединены с входами старших разрядов второго блока памяти и информационным выходом третьего счетчика импульсов, Входы младших разрядов второго блока памяти соединены с выходом второй схемы сложения по модулю два, первый выход второго блока памяти подключен к информационному входу второго счетчика импульсов, а второй выход соединен с входом управления коэффициентом деления делителя частоты, вход установки в начальное состояние которого подключен к прямому выходу третьего триггера, второму входу второй схемы сложения по модулю два и к второму входу элемента И - ИЛИ, третий вход которого соединен с выходом делителя частоты, а выход элсмента И - ИЛИ соединен со счетным входом второго счетчика импульсов и с вторым входом пятого элемента И, первый вход которого соединен с выходом второго элемента ИЛИ, Второй вход которого подключен к выходу третьего элемента И, а третий вход соединено счетным входом третьего триггера, с выходом пятого элемента И и с управляюгцим входом второго счетчика импульсов, информационный выход которого соединен с входом третьего элемента И.