Устройство для приема дискретной информации

союз советскихсоциАлистическихРЕСПУБЛИК 526 А 1 16 51)5 Н 0417/16 ИСАНИЕ ИЗОБРЕТЕНИЯ У СВИДЕТЕЛЬСТВ К АВТ 11 ОСУДАРСТВЕННЫЙ КОМИТЕТПО ИЗОБРЕТЕНИЯМ И ОТКРЫТИЯМПРИ ГКНТ СССР(56) Авторское свидетельство СССРй 1048580, кл. Н 04 1. 5/ОО, 1982.(54) УСТРОЙСТВО ДЛЯ ПРИЕМАДИСКРЕТНОЙ ИНФОРМАЦИИ(57) Изобретение относится к технике передачи дискретной информации и может использоваться при организации систем связи и вычислительных сис 1 ем с общим каналом связи, Цель изобретения - увеличение объема принимаемой информации, Устройство для приема дискретной информации содержит задающий генератор 7, блок 10 дешифраторов, блок 11 элементов И, приемники 12 дискретных сигналов. Цель достигается введением амплитудного ограничителя 1, компаратора 2, ВЗ-триггера 3, первого, второго элементов И 4, 6, блока 5. регистров сдвига, блока 8 счетчиков, инвертора 9, В устройстве обеспечивается возможность передачи по одному каналу связи инфрмации от й источников дискретных сигналов. При этом каждое устройство для приема дискретных сигналов будет принимать информацию, которая предназначается только ему, 1 ил.10 15 Изобретение относится к технике передачи дискретной информации и может использоваться при организации систем связи и вычислительных систем с общим каналом связи.Цель изобретения - увеличение объема принимаемой информации,На чертеже представлена структурная электрическая схема предлагаемого устройства.Устройство для приема дискретной информации содержит амплитудный ограничитель 1, компаратор 2, ЙБ-триггер 3, первый элемент И 4, блок 5 регистров сдвига, второй элемент И 6, задающий генератор 7, блок 8 счетчиков, инвертор 9, блок 10 дешифраторов, блок 11 элементов И, приемники 12 дискретных сигналов,Устройство работает следующим образом,На вход устройства поступает цифровая последовательность, к которой первый бит является синхронизирующим и по уровню превосходит уровень логической "1" остальных битов, что вызвано необходимостью обеспечения стабильной синхронизации и высокой помехоустойчивости. Синхрочмпульс одновременно поступает на амплитудный ограничитель 1, в котором он ограничивается до уровня логической "1" других битов с тем, чтобы не вносить искажения в работу элементов устройства, и на второй вход компаратора 2, где осуществляется сравнение его с напряжением Ооп (величина Ооп больше уровня логической "1", но меньше уровня синхроимпульса), В результате этого сравнения на выходе компаратора 2 вырабатывается сигнал логической "1", который поступает на Я-вход ЙЯ-триггера 3, переводит его в единичное состояние, так как на Й-входе в это время имеется уровень логического "О",При появлении "1" на первом входе первого элемента И 4 ограниченный по уровню синхроимпульс и М маркерных импульсов через его второй вход последовательно поступают на информационный вход блока 5 регистра сдвига и регистрируются посредством тактовых импульсов, поступающих на его тактовый вход с выхода задающего генератора 7,Таким образом, на выходах блока 5 регистров сдвига появляется (М+1)-разрядный параллельный код, причем вследствие того, что информацию о номере канала несут только М маркерных импульсов, то все они поступают на соответствующие выходы блока 10 дешифраторов, а синхроимпульс с (М+1)-го выхода блока 5 регистров сдвига одновременно поступает на управляющий 20 25 30 35 40 45 50 55 вход выбора режима блока 5 регистров сдвига, обеспечивая уровнем логической "1" перевод его в режим хранения, на вход сброса блока 8 счетчиков, активном уровнем которого является уровень логического "0", разрешая тем самым подсчет тактовых импульсов, поступающих на его счетный вход с выхода задающего генератора 7, и, наконец, на первый вход второго элемента И 6, в результате чего К информационных импульсов через его третий вход проходят на все элементы И блока 11 элементов И, так как в это время на его втором входе также имеется логическая "1" М-разрядный код маркерных импульсов дешифрируется блоком 10 дешифраторов, и из всех его й выходов активный уровень появляется только на одном, а именно на том, номер которого равен поданному на вход двоичному числу,Тогда на первом входе соответствующего элемента И блока 11 элементов И присутствует логическая "1", разрешая тем самым прохождение информационных импульсов через второй вход на вход соответствующего приемника 12 дискретных сигналов. В это время на выходе переноса блока 8 счетчиков после подсчета К-го тактового импульса вырабатывается единичный импульс, служащий сигналом о том, что все К информационных импульсов, предназначавшихся й-му приемнику 12 дискретных сигналов, приняты. Поступая на Й-вход ЙЯ-триггера 3, этот импульс пеоеводит его в нулевое состояние, соответствующее ожиданию прихода нового синхроимпульса, и проинвертировались инвертором 9, он уровнем логического"0" последовательно обнуляет все выходы блока 5 регистров сдвига и через его (М+1)-й параллельный выход - блок 8 счетчиков, а также обеспечивает нулевым уровнем режим сдвига вправо блока 5 регистров сдвиФормула изобретения Устройство для приема дискретной информации, содержащее задающий генератор, приемники дискретных сигналов и блок дешифраторов, выходы которого подключены к одним входам блока элементов И, о т ли ч а ю ще ес я тем, что, с целью увеличения обьема принимаемой информации, введены два элемента И, блок регистров сдвига, инвертор, блок счетчиков, амплитудный ограничитель и последовательно соединенные компаратор и ЙЯ-триггер, Й-вход и выход которого соединены соответственно с выходом блока счетчиков, который подключен к входу инвертора, и с первым входом первого элемента И, второй вход и выход которого соединены соответственно,с выходом амплитудного ограничителя, вход которого подключен к1665526 Составитель В. ЧибисовТехред М.Моргентал Корректор О. Кундрик Редактор М, Бланар Заказ 2400 Тираж 390 Подписное ВНИИПИ Государственного комитета по изобретениям и открытиям при ГКНТ СССР 113035, Москва, Ж, Раушская наб., 4/5 Производственно-издательский комбинат "Патент", г. Ужгород, ул.Гагарина, 101 одному входу компаратора, и с информационным входом блока регистров сдвига, одни выходы и тактовый вход которого соединены соответственно с входами блока дешифраторов и с выходом задающего генератора, который подключен к счетному входу блока счетчиков, сбросовый вход которого соединен с управляющим входом и другим выходом блока регистров сдвига, который подключен к первому входу второго элемента И, второй и третий входы и выход которого соединены соответственно с выходом инвертора, который подключен к сбросовому входу блока регистров сдвига, с выходом первого элемента И и с другими 5 входами блока элементов И, выходы которого подключены к входам соответствующих приемников дискретных сигналов, при этом другой вход компаратора является опорным входом устройства, информационным вхо дом которого является вход амплитудногоограничителя.