Пороговый элемент

СОЮЗ СОВЕТСКИХСОЦИАЛИСТИЧЕСКИХРЕСПУБЛИК 9 23 йр(Цфф ,И льство СССР 19/23, 1982.ство СССР 19/23, 1982. ГОСУДАРСТВЕННЫЙ КОМИТЕТ СССР ПО ДЕЛАМ ИЗОБРЕТЕНИЙ И ОТКРЫТИ ПИСАНИЕ ИЗОБРВТОРСКОМ,ФСВИДЕТЕЛЬСТ(57) Изобретение относится к области автоматики и вычислительной техники и может быть использовано для построения устройств обработки дискретной информации. Устройство содержит сканируюший мультиплексор 1, накопитель 3, триггер 5, блок 6 сброса и генератор 7 тактовых импульсов. Введение блока 2 формирования пачек импульсов, блока 4 формирования порога, элемента И 8 и образование новых функциональных связей повышают быстродействие порогового элемента. 10 ил., СкворцовКорректо Подписи о делам изобретен ская наб., д. 4/5 ие г Ужгород ул р О. Кундрикей и открытий Проектная, 4 Составитель ОРедактор П. Гереши Техред И. ВереЗа каз 1231/57 Тираж 928ВНИИПИ Государственного комитета СССР п113035, Москва, Ж - 35, РаушПроизводственно-полиграфическое предприятИзобретение относится к автоматике и вычислительной технике и может быть использовано для построения различных устройств обработки дискретной информации.Цель изобретения - повышение быстродействия порогового элемента.На фиг. 1 изображена структурная схема порогового элемента; на фиг. 2 - 3 - схема блока формирования пачек импульсов; на фиг. 4 - то же, для порогового элемента на семь входов с весами ч = = 9, 8, 7, 7, 6, 4, 1; на фиг, 5 - схема блока настройки; на фиг. 6 - структурная схема адаптивного сканирующего мультиплексора; на фиг. 7 - схема реализации разряда адаптивного сканирующего мультиплек сора; на фиг. 8 - схема адаптивного сканирующего мультиплексора на фиг. 9 и 10 - схемы коммутаторов.Пороговый элемент (содержит сканирующий мультиплексор 1, блок 2 формирования пачек импульсов, накопитель 3, блок 4 формирования порога, триггер 5, блок 6 сброса, генератор тактовых импульсов 7 и элемент И 8,Генератор 7 соединен выходом со счетным входом блока 2 формирования пачек импульсов и с первыми входами блока 6 сброса и элемента И 8, выход которого соединен со счетным входом сканирующего мультиплексора 1, Сканирующий мультиплексор 1 соединен информационными входами с вход ными информационными шинами 9, выходом переноса - с вторым входом блока 6 сброса, а группой информационных выходов - с управляющими входами блока 2 формирования пачек импульсов, соединенного группой выходов со счетными входами накопителя 3, а выходом блокировки - с вторым входом элемента И 8. Блок 4 формирования порога соединен входами с выходами накопителя 3, а выходом - с информационным входом триггера 5 и третьим входом блока 6 сброса, первый выход которого соединен с входом разрешения записи триггера 5, а второй - с входами сброса сканирующего мультиплексора 1, блока 2 формирования пачек импульсов и накопителя 3. Выход триггера 5 является выходом 10 устройства,Блок 2 формирования пачек импульсов может быть выполнен, как показано на фиг. 2 Он содержит распределитель 11 импульсов, группы 12 - 1 - 12 - К элементов И, где К - число входов порогового элемента, в двоичном представлении веса которых более одной единицы, элементы ИЛИ 13 - 15, установочный триггер 16, элементы И 17 и 18, инвертор 19, установочный триггер 20, тактовый вход 21 и выход 22. Выходы разрядов распределителя 11 импульсов от первого до (1+ 1) -го (= 1 оя 2 (%мккс+1)- 1) соединены с входами групп элементов И 12 -12 - К, входы которых соединены также с управляющими входами 23 блока. Выходы 5 10 15 20 25 ЗО 35 40 45 50 55 элементов И групп 12 - 1 - 12 - К соединены с входами элементов ИЛИ 13 - 1 - 13 - (1+) и 15. Входы элементов ИЛИ 13 и 14 соединены также с управляющими входами 23 блока.Выход элемента ИЛИ 14 соединен с входом прямого плеча триггера 16, а выход элемента ИЛИ 15 - с входом его инверсного плеча. Прямой и инверсный выходы триггера 16 соединены с первыми входами элементов И 17 и 18 соответственно, вторые входы которых соединены с выходом инвертора 19 соединенного входом со счетным входом распределителя 11 импульсов и всего блока. Выходы элементов И 17 и 18 соединены с входами прямого и инверсного плеч триггера 20, прямой выход которого соединен с входом сброса распределителя 1 импульсов, а инверсный выход - с выходом блокировки блока. Имеется также вход 24 сброса,Каждая группа 12 -элементов И содержит С; - 1 элементов И, первые входы которых соединены с потенциальным выходом 1-го разряда сканирующего мультиплексора 1 (управляющий вход 2 блока), а вторые входы - с выходами разрядов распределителя 11 импульсов от первого до (С; - 1)-го, где С; - количество ненулевых разрядов в двоичном представлении веса ч; 1-го входа порогового элемента. В частном случае, когда С;= 1, т.е. ч;=2 Р, соответствующая группа элементов И отсутствует. Входы элемента ИЛИ 13-) соединяются с выходами одного из элементов И каждой группы 12 - 1, для которой в двоичном представлении веса ч, в разряде с весом 2имеется единица, если он не является старшим разрядом, Кроме того, входы элемента ИЛИ 13- соединяются с импульсными выходами разрядов сканирующего мультиплексора 1 (управляющие входы Х; блока), для которых 2)ж,)2 . Оптимальным с точ ки зрения повышения быстродействия является соединение, когда элемент И, соединенный входом с выходом распределителя 1 импульсов с меньшим номером, соединя. ется с входом элемента ИЛИ 13 с большим номером.Входы элемента ИЛИ 15 соединены с выходами последних элементов И групп 12 - 1 - 12 - К, соединенных входом с выходом разряда распределителя 11 импульсов с наибольшим номером по сравнению с другими элементами И данной группы.Входы элемента ИЛИ 14 соединены с выходами разрядов сканирующего мультиплексора 1 (управляющие входы Х;), для которых количество единиц в двоичном числе (представлении) веса входа не менее двух.Блок формирования пачек импульсов может быть выполнен также настраиваемым, как показано на фиг. 3.Он содержит распределитель 11 импульсов, блоки 25 - 1 - 25 - п настройки,зэлементы ИЛИ 13 - 1 - 13 - (Г+1) и 14, инвертор 19, установочный триггер 16, элементы И 17 и 18 и установочный триггер 20.Входы каждого блока 25 -настройки (1=1и) соединены с выходами 1-го разряда сканирующего мультиплексора 1 (импульсным и потенциальным) и выходами разрядов распределителя 11 импульсов от первого до 1-Го (= - - очаг(юмакс+1)- 1), а выходы - с входами элементов ИЛИ 13, причем )-й выход каждого блока 25 -настройки соединен с входом элемента ИЛИ 13 - (- )+2), входы элемента ИЛИ 14 соединены с входами блоков 25 настройки, которые подключены к импульсным выходам сканирующего мультиплексора 1, а выход элемента ИЛИ 14 соединен с входом прямого плеча триггера 16, вход инверсного плеча которого соединен с выходом (1+1) -го разряда распределителя 11 импульсов.Прямой и инверсный выходы триггера 16 соединены с входами элементов И 17 и 18 соответственно, вторые входы которых соединены с выходами инвертора 19, вход которого соединен со счетным входом распределителя 11 импульсов и тактовым входом 21 блока. Выходы элементов И 17 и 18 соединены со входами прямого и инверсного плеч триггера, 20 соответственно. Прямой выход триггера 20 соединен со входом сброса распределителя 11 импульсов, а инверсный выход плеча триггера 20 - с выходом 22 блока. Вход 24 сброса блока соединен с вторыми входами инверсных плеч триггеров 16 и 20. Блоки 25 настройки соединены настроечными входами с входами настройки блока формирования пачек импульсов.Каждый блок 25 настройки (фиг. 5) содержит (1+1) элементов И 26 - 1 - 26 - (1+ +1), первые входы которых соединены с входами настройки блока. Второй вход первого из элементов И 26 - 1 соединен с импульсным выходом соответствующего разряда сканирующего мультиплексора 1. Вторые входы остальных элементов И 26 - 2 - 26 - (+1) соединены с выходами разрядов распределителя 11 импульсов, а третьи входы - с потенциальным выходом соответствующего разряда сканирующего мультиплексора 1 (Х;).Распределитель 11 импульсов может быть выполнен в виде кольцевого счетчика или регистра сдвига на (1+1) разряд, причем единичный потенциал появляется на его выходах в течение длительности тактового импульса на счетном входе.Блок сброса может быть выполнен в виде элемента ИЛИ, входы которого являются вторым и третьим входами блока, а выход соединен с входом первого элемента И и элемента задержки, выход которого соединен с входом второго элемента И, инверсный вход которого является первым входом блока, а выход - его вторым выходом. Выход второго элемента И соединен с инверсным входом первого элемента И, выход которого является первым выходом блока. Время задержки т блока задержки выбирается в пределах1 цмп (т (тпаузйБлок формирования порога может бытьвыполнен на элементах И и ИЛИ следующим образом.Пусть двоичное представление порога аимеет вида=а 2"+аг 2а 12 г+а 2 + +а 2а;.12+а;+г 2а;+з 2+г++а 2"а.2", где 1.1=1 одДХ,+1- 1Пусть а,=аг==а 1=0. Выходы накопителя 3, начиная с 1-го и до 1-го, такие, что а=а.==а;=+1, а а;+1=0, соединены с входами элемента И, выход которого, а также выходы накопителя 3, начиная с (+1)-го и до 1-го, такие, что а; = 20 =а 1+г==а;=О, а а;.=1, соединены свходами элемента ИЛИ, выход которого, а также выходы накопителя 3, начиная с (1+1)-го и кончая входом с номером 1, такие, что к;= ;, =сс = 1, а с;+, -- О, соединены с входами элемента И и так далее до объединения всех остальных выходов накопителя 3. Если к+, - - 1, то последним является элемент И, а если о, = 0 - элемент ИЛИ.Выход элемента, с входом которого соединен выход старшего разряда накопителя 3,является выходом блока формирования порога.В частном случае, когда а=2" (д==0,1,2,), блок формирования порога состоит из элемента ИЛИ, соединенного входами с выходами накопителя 3, начиная с 35 (с+ ) -го и до последнего. Когда а==а.==а=1, блок формирования порога состоит из элемента И, соединенного входами с выходами накопителя 3, нациная с д-го и до последнего.Адаптивный сканирующий мультиплексор 40 может быть выполнен, как показано на фиг. 6Он содержит разряды 27 - 1 - 27 - (и+2) распределителя импульсов и блоки 28 - 1 - 28 - и коммутации. Входы-выходы переноса каждого из разрядов 27 - 1 распределителя45импульсов (1=1, 2,и) соединены с первой группой входов-выходов блока 28 - 1 коммутации, вторая группа входов-выходов блока 28 - 1 коммутации (1=1, 2, , и - 1) соединена с третьей группой входов-выходов блока 28 - (1+1), вторая группа входов-выходов блока 28 - и коммчтации соединена с входами в выхода переноса разряда 27 - (и+ 1) распределителя импульсов, соединенного другой группой входов-выходов переноса с входами-выходами переноса разряда 27 в (и+2), другая группа входов-выходов 55 которого соединена с третьей группой входов-выходов блока 28 - 1 коммутации. Управляющие входы блоков 28 коммутации соединены с входными информационными5шинами 9, Выходами сканирующего муль- типлексора являются импульсные и потенциальные выходы разрядов 27 -распределителя импульсов. Входы сброса разрядов распределителя 27 -импульсов соединены с входом сброса сканирующего мультиплексора, а их счетные входы - со счЕтным входом мультиплексора,Адаптивный сканирующий мультиплексор может быть реализован при любой (регулярной) реализации распределителя импульсов, Разница заключается в требуемом количестве коммутаторов в каждом блоке 28 коммутации (по числу пар входов-выходов переноса в разряде распределителя импульсов). С входами каждого коммутатора соединяются одноименные выходы данного и предыдущего (последующего, если перенос в данный разряд по данному входу происходит из последующего разряда) разрядов распределителя импульсов, его первый выход соединяется с соответствующим входом данного разряда, а второй является выходом блока коммутации.Схемная реализация разряда 27 распределителя импульсов изображена на фиг. 7, где также показаны схемная реализация блока 28 коммутации (нижний блок).Сканирующий мультиплексор может быть выполнен в виде распределителя импульсов на п+1 разряд, выходы первых и разрядов которого соединены каждый с входами своего элемента И, вторые входы элементов И являются информационными входами сканирующего мультиплексора.Выходы элементов И являются импульсными выходами разрядов сканирующего мультиплексора. При реализации разрядов распределителя импульсов, показанной на фиг. 7 (верхний блок), потенциальный выход триггера является выходом разряда. Разряд 27 распределителя импульсов (фиг. 7) имеет два входа 29 - 1 и 29 - 2 и один выход 30 переноса с предыдущего разряда и соответственно два выхода 31 - 1 и 31 - 2 и один вход 32 переноса с последующего разряда. Парами входов-выходов разрядов 27 являются входы и выходы 29 - 1 и 31 - 1, 29 - 2 и 31 - 2, 32 и 30. В соответствии с этим каждый блок 28 коммутации содержит три коммутатора 33 - 1 - 33 - 3, управляющие входы которых соединены вместе и с входной шиной устройства. Вход коммутатора 33 - 1 соединен с выходом 31 - 1 разряда 27, а первый выход - с его входом 29 - 1. Вход коммутатора 33 - 2 соединен с выходом 31 - 2 разряда 27, а первый выход - с его входом 29 - 2, Вход коммутатора 33 - 3 соединен с выходом 30 разряда 27, а первый выход - с его входом 32, Выходы разряда 27 соединены с первыми входами коммутаторов 28, а вторые входы являются входами блока коммутации. 10 15 20 ". г;30 35 40 45 50 55 С хемная реализация адаптивного сканирующего мультиплексора показана на фиг. 8 для случая схемной реализации разряда распределителя импульсов, изображенной на фиг. 7. Схемная реализация коммутаторов для случая импульсов отрицательной полярности показаНа на фиг. 9, а для случая импульсов положительной полярности - на фиг. 4. На фиг. 4 и 9 первым входом коммутатора является вход, соединенный с нижним из трех элементов И (И - НЕ), а вторым входом - вход, соединенный с входами верхнего и среднего элементов И (И - НЕ). Первым выходом коммутатора является выход верхнего элемента И (И - НЕ).Адаптивный сканирующий мультиплексор функционирует следующим образом.Если на входную шину Х;: подан нулевой потенциал, то блок 28 вкоммутации отключает входы-выходы разряда 27 враспределителя импульсов от предыдущего и последующего разрядов и работает в режиме трансляции сигналов, поступающих на его входы с выходов блока (разрядов) 28 - (1+ +) и 28 - ( - 1) коммутации на входы блоков 28 - ( - 1) и 28 - (+1) соответственно. Если Х;=1, то блок 28 - 1 коммутации подключает входы-выходы разряда 27 -распределителя импульсов к входам-выходам блоков 28 - ( - 1) и 28 - (+1) коммутации. В результате все разряды 27 -распределителя импульсов, для которых Х;=О, оказываются отключенными и образуется распределитель импульсов только из разрядов, для которых Х;=1.При подаче тактовых импульсов осуществляется последовательное формирование на выходах разрядов 27 импульсов, причем на выходах только тех разрядов, для которых Х;=. Таким образом исключается опрос входных шин, для которых Х,=О, что обеспечивает повышение быстродействия.Таким образом, опрос всех входных шин осуществляется не за и тактов, хак в известном устройстве, а лишь за ЬХ тактов.айТриггер 5 по выполняемым функциям является тактируемым 0-триггером. Описанная выше схема блока б сброса соответствует случаю, когда разрешение записи по Т-входу триггера осуществляется сигналом положительной полярности. В противном случае первый элемент И блока 6 сброса следует заменить элементом И - НЕ.Блок сброса может быть выполнен и в виде элемента ИЛИ, входы которого являются вторым и третьим входами блока, а выход соединен с первым входом первого элемента И, выход которого является первым выходом блока, выход элемензз ИЛИ соединен также с входом элемента задержки (на время т(тз(т., если ти .(тп, и на5 10 15 20 чае Хж,Х;(а. время тп(тз(т-., если т.(ти-, где ти ., т. - длительность импульса и паузы тактовых импульсов), выход которого соединен с входом второго элемента И, инверсный вход которого соединен с вторым входом первого элемента И и является третьим входом блока. Выход второго элемента И является вторым выходом блока. Данная схема также соответствует случаю, когда сброс блоков 1 - 3 и запись в триггер 5 производятся сигналом положительной полярности.В дальнейшем при описании функционирования устройства (фиг, 1) будем полагать, что сброс всех блоков производится импульсом положительной полярности. Если схемная реализация какого-либо из блоков требует сигнала отрицательной полярности (нулевого потенциала), то на его входе сброса следует установить инвертор, вход которого при этом и будет входом сброса.Распределитель импульсов в сканирующем мультиплексоре 1 (фиг. 1) может иметь любую из известных схемных реализаций комбинированного распределителя, обеспечивающего одновременно распределение импульсов и потенциалов.Для повышения быстродействия сигнал переноса может сниматься с выхода предпоследнего и-го разряда распределителя импульсов, что обеспечит сокращение на один такт цикл работы устройства в слуИспользуемый в блоке 2 (фиг. 2 - 4) распределитель 11 импульсов может иметь любую из известных реализаций, в том числе и реализацию, рассмотренную выше для распределителя в сканирующем мультиплексоре 1.В схемах на фиг. 2 - 4 и описании функционирования полагается, что сброс распределителя 11 импульсов производится импульсом отрицательной полярности (нулевым сигналом). Если используемая схемная реализация требует для сброса сигнал положительной полярности (единичным сигналом), необходимо либо подавать сигнал на вход сброса через инвертор, либо использовать сигнал с инверсного плеча триггера 20 (фиг. 2 - 4).В приводимом далее описании функцио. нирования устройства в целом и блока 2 формирования пачек импульсов полагаем, что ЯЯ-триггеры 16 и 20 (фиг. 2 - 4) переключаются импульсом положительной полярности. Если использовать КЯ-триггеры, переключаемые импульсом отрицательной полярности (нулевым сигналом), необходимо элементы ИЛИ 14 и 15 и И 17 и 18 (фиг. 2 - 4) заменить элементами ИЛИ - НЕ и И - НЕ соответственно. При этом необходимо учесть, что потребуется нулевой сигнал сброса, т.е. требуется либо установка на входе сброса инвертора, обеспечивающего ин 25 30 35 40 45 50 55 вертирование сигнала сброса положительной полярности, либо (если сброс всех блоков на фиг. 1 осуществляется нулевым сигналом) замена в блоке сброса второго элемента И элементом И - НЕ.Напопитель 3 может быть выполнен в виде двоичного счетчика, выход переноса 1-го разряда которого соединяется со счетным входом (1+1)-го разряда через элемент ИЛИ, второй вход которого является входом накопителя с весом 2. Количество разрядов накопителю равно од(Хи;+1) .Й Схема такой реализации накопителя практически представляет собой счетчик с последовательным переносом. Входы сброса всех триггеров соединяются с входом сброса накопителя.В описании функционирования устройства и в схемах на фиг. 1 предполагается, что переключение накопителя 2 осуществляется по переднему фронту импульса на счетном входе (полагаем импульс положительной полярности) и в течение длительности тактового импульса на его выходе появляется результат. При использовании реализации накопителя 3, формирование результата на выходе которого осуществляется по заднему фронту счетных импульсов (по переднему фронту импульсов отрицательной полярности), устройство функционирует в том же порядке, как описано далее. Разница заключается в том, что окончание цикла работы устройства в случае записи в накопитель 3 кода числа, большего или равного порогу а, происходит на следующем такте.Для повышения быстродействия устройства накопитель может быть реализован на счетчике с параллельным переносом. Счетным входом с весом 2" является вход первого триггера. Его прямой выход Я-выход, на котором сигнал появляется в момент прихода заднего фронта тактового импульса положительной полярности) соединяется с первым входом элемента И, второй вход которого соединяется со счетным входом первого триггера. Выход элемента И соединен со входом элемента ИЛИ, второй вход которого является входом накопителя с весом 2, а выход соединен со счетным входом триггера следующего (второго) разряда накопителя импульсов. Указанный элемент ИЛИ является первым элементом ИЛИ второго разряда накопителя, а его вход, соединенный с выходом элемента И - первым входом второго разряда.Второй и третий элементы ИЛИ второго разряда соединены первыми входами с выходом (прямым) первого триггера и его счетным входом соответственно и являются соответственно вторым и третьим входами второго разряда накопителя. Вторые входы элементов ИЛИ (второго и третьего) второгоразряда накопителя соединены с вторымвходом первого элемента ИЛИ. Выход второго элемента ИЛИ соединен с первымвходом первого элемента И, второй вход которого соединен с прямым выходом триггеравторого разряда Щ-выход, на котором сигнал появляется в момент окончания тактового импульса на счетном входе - по егозаднему фронту), а выход является вторымвыходом второго разряда накопителя. Выходпервого элемента И соединен также с первым входом второго элемента И, второй входкоторого соединен с выходом третьего элемента ИЛИ, а выход является первым выходом второго разряда накопителя. Третьимвыходом второго разряда накопителя является выход третьего элемента ИЛИ.Последующие разряды накопителя имеюттакую же схемную реализацию, как и второйразряд, описанный выше, а их соединениеосуществляется таким образом, что первый,второй и третий выходы 1-го разряда соединяются с первым, вторым и третьим входами (1+1) -го разряда. Разряды накопителя,не имеющие дополнительного счетного входа, отличаются от рассмотренных выше отсутствием элементов ИЛИ, т.е. первый входразряда соединен непосредственно со счетным входом триггера, второй вход - с первым входом первого элемента И, а третий вход - со вторым входом второго элемента И и третьим выходом. Порядок соединения разрядов сохраняется, т.е. выходыот первого до третьего 1-го разряда соединяются соответственно с входами от первогодо третьего (1+1) -го разряда.Выходами накопителя являются прямыевыходы триггеров, на которых сигнал появляется в момент появления счетного импульса на счетном входе,Входы сброса всех разрядов накопителя (входы сброса счетных триггеров) соединяются с вхоДом сброса накопителя;В рассмотренном случае требуется сигнал сброса отрицательной полярности (нулевой сигнал). В приводимом далее описанииработы устройства полагаем сигнал сбросаположительной полярности. В этом случаетребуется подавать сигнал сброса на входыразрядов накопителя через инвертор либопроинвертировать его в блоке сброса.С целью повышения быстродействиясхема разряда накопителя 3, рассмотреннаявыше для его реализации на счетчике с параллельным переносом, может быть изменена, Вместо соединения выхода первого элемента И с первым входом второго элемента И, входы первого элемента И соединяются с первым и третьим входами второгоэлемента И, а его второй вход остается соединенным с выходом третьего элемента ИЛИ.Пороговый элемент функционирует следующим образом,В исходном состоянии сканирующиймультиплексор 1, блок 2 формирования па 55 5 10 15 20 30 35 40 45 50 10чек импульсов и накопитель 3 сброшены. При этом в накопитель 3 записан нулевой код, а на выходе блокировки блока 2 формирования пачек импульсов присутствует единичный логический сигнал, который поступает на вход элемента И 8, разрешая прохождение тактовых импульсов с выхода генератора 7 на счетный вход. сканирующего мультиплексора 1.При поступлении тактовых импульсов на счетный вход сканирующего мультиплексора 1 он производит последовательный опрос входных информационных шин 9. При этом он последовательно подключает каждый 1-й вход к 1-му выходу, Если на 1-й входной шине имеется единичный сигнал, то во время ее опроса единичный сигнал появляется на 1-м выходе сканирующего мультиплексора 1 (каждый 1-й выход содержит две шины, по которым подаются импульсный и потенциальный выходной сигнал.1-го разряда сканирующего мультиплексора, причем импульсный сигнал имеет место только в течение длительности тактового импульса, а потенциальный - также и в течение паузы до прихода следующего тактового импульса на вход мультиплексора). Единичный сигнал с 1-го выхода сканирующего мультиплексора 1 поступает на управляющий вход блока 2 формирования пачек импульсов. Если в двоичном представлении М; имеется только одна единица в)-м разряде с весом 2 , то импульс с выхода мультиплексора 1 проходит на выход блока 2 и в течение длительности тактового импульса на информационном выходе блока 2, имеющем вес 2 , появляется единичный сигнал, поступающий на вход накопителя 3, имеющий вес 2 , при этом к содержимом накопителя прибавляется код числа 2 . Далее на следующем такте происходит опрос следующего входа,Если в двоичном представлении веса в; опрашиваемого входа имеется более одной единицы, то в момент поступления импульса на управляющий вход блока 2 формирования пачек импульсов он инициализируется, при этом в течение длительности текущего импульса и последующих тактовых импульсов на выходах блока 2 с весами, равными весам единичных разрядов двоичного представления веса ч; входа, появляются единичные сигналы, поступающие на входы накопителя 3 с соответствующими весами, который при этом прибавляет к своему содержимому коды чисел, равные весам единичных разрядов двоичного представления веса ч;,После окончания тактового импульса, по которому производится опрос данной входной шины устройства, на выходе блокировки блока 2 появляется нулевой сигнал, поступающий на вход элемента И 8 и запрещающий дальнейшее прохождение тактовых импульсов на счетный вход сканирующегомультиплексора 1. По окончании цикла работы блока 2 формирования пачек импульсов, в течение которого к содержимому накопителя 3 прибавляется код числа ж;, в паузу между тактовыми импульсами на выходе блокировки блока 2 появляется единичный потенциал и следующий тактовый импульс проходит на счетный вход сканирующего мультиплексора 1. Работа порогового элемента происходит таким образом до момента появления на выходах накопителя, кода числа, большего или равного порогу элемента, или до момента опроса всех входов устройства.В первом случае в момент, когда на выходах накопителя 3 появляется код числа, большего или равного порогу а, на выходе блока 4 формирования порога появляется единичный сигнал, поступающий на информационный вход триггера 5 и третий вход блока 6 сброса. При этом в течение длительности тактового импульса на первом выходе блока 6 сброса появляется единичный сигнал, поступающий на вход резрешения записи триггера 5, разрешая запись в нею единичного сигнала с выхода блока 4 формирования порога, при этом на выходе триггера 5 появляется единичный сигнал,Во втором случае после опроса всех входов Х; в накопителе 8 оказывается записан код числа, меньшего порога а. При поступлении очередного тактового импульса на выходе переноса сканируюшего мультиплексора 1 появляется единичный сигнал, поступающий на вход блока 6 сброса. На первом выходе блока 6 сброса появляется единичный сигнал, разрешающий запись в триггер 5 нулевого сигнала с выхода блока 4 формирования порога. В обоих рассмотренных случаях после записи в триггер 5 результата вычисления, на втором выходе блока 6 сброса в паузу меж ду тактовыми импульсами появляется единич ный сигнал, поступающий на входы сброса сканирующего мультиплексора , блока 2 формирования пачек импульсов и накопителя 3, возвращающий их в исходное состояние.Цикл работы порогового элемента окончен. Если Хв;Х;)а, то на выходе триггера 5присутствует единичный сигнал, в противном случае - нулевой.10Формула изобретенияПороговый элемент, содержащий триггер, выход которого соединен с выходом порогового элемента, сканирующий мультиплексор, соединенный информационными входами с входными информационными шинами порогового элемента, входом сброса - с входом сброса накопителя и вторым выходом блока сброса, соединенного первым 20 входом с выходом генератора тактовых импульсов, вторым входом - с выходом переноса сканируюшего мультиплексора, третьим входом - с информационным входом триггера, а первым выходом - с входом разрешения записи триггера, отличаюиийся тем, что, с целью повышения быстродействия, введены блок формирования пачек. импульсов, блок формирования порога и элемент И, причем блок формирования порога соединен входами с выходами накопителя, а 30выходом - с информационным входом триггера и третьим входом блока сброса, блок формирования пачек импульсов соединен управляющими входами с информационными выходами сканирующего мультиплексора, счетным входом - с первым входом элемента И и выходом генератора тактовых импульсов, группой выходов - со счетными входами накопителя, входом сброса - с вторым выходом блока сброса, а выходом блокировки - с вторым входом элемента И, выход которого соединен со счетным входом сканирующего мультиплексора, 1387191